1、完成 ADC、DAC,PLL、PMU,IO 等模拟 IP 的版图设计
2、完成模拟或数模混合信号全芯片整体版图设计
3、根据电路设计对版图进行合理摆放和隔离
4、配合电路设计工程师完成后仿真优化
5、评估芯片后端设计需要的工作量,为项目进度规划提供合理的依据
任职要求:
1、电子相关专业本科及以上学历
2、2年及以上模拟版图设计经验
3、对 ESD、Latch-up 设计规则有良好理解
4、熟悉 LVS/DRC Command File,有一定修改能力
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1、负责芯片从Netlist到GDS输出的后端设计工作。
2、负责P&R 流程,Floor plan,IO plan,power plan,Place,CTS,布线,时序分析,IR drop,物理验证(DRC, LVS),ECO.
任职要求:
1、熟悉布局布线、物理验证、静态时序分析等后端流程。
2、熟悉Encounter/Innovus等物理设计工具的使用。
3、具有低功耗电路后端设计经验;
4、具有40nm及以下工艺流片经验;
5、熟悉逻辑综合、DFT、STA等ASIC流程实现方法;
6、良好的团队精神,抗压力能力强、为人正直,工作态度端正,责任心强。
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1、在SoC开发过程中,和DFT架构一起,负责PHY、模拟等IP测试方案的规划,并验证对应的方案。
2、负责PHY、模拟等IP的ATE测试程序的开发与调试
3、良率优化以及质量问题的处理;
4、从事DFT设计流程改进、IP功能测试设计及验证;
5、根据芯片规格,参与 load board的设计
6、优化测试程序降低测试时间,提高测试覆盖率
任职要求:
1、大学本科及以上学历,微电子,自动化,计算机等半导体相关理工类专业
2、熟悉 模拟IP的测试,PCIE USB DDR MIPI PLL ADC/DAC 等;
3、熟悉 芯片验证环境 和 VCS等 仿真工具
4、了解DFT的基本原理,能做简单的debug
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1、与IC设计工程师密切合作,负责IC设计项目相关验证计划的制定,验证结果的评审,制定合适的验证策略、方案
2、开发验证平台,使用Verilog, System Verilog, UVM/OVM等语言/工具,实现高效率的芯片功能、性能验证,完成验证执行和Debug,满足Tape Out需求
3、对IC设计项目的验证进度和质量负责,并能承担具体的技术任务
4、协同设计和软件工程师进行FPGA平台验证调试
任职要求:
1、本科及以上学历,电子、通信、计算机、半导体物理或微电子等专业
2、具有3年以上数字IP或 SOC验证经验
3、具有扎实的IC验证基础,熟悉IC验证的环境、流程,掌握NC-Sim/VCS等相关验证工具,掌握一种或多种验证语言
4、具有良好的沟通能力、协调能力以及团队合作意识
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